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타이밍 분석과 CDC

주기 2.0 ns인 클럭으로 동작하는 회로에서 데이터의 도착 시각(클럭→출력 지연과 조합 회로 지연의 합)이 3.3 ns, 셋업 타임이 0.1 ns인 경로가 있습니다. 이 경로는 2사이클에 한 번만 캡처하면 되므로 셋업 멀티사이클 패스를 2로 설정했습니다. 셋업 슬랙은 얼마입니까?

  1. A−1.4 ns
  2. B+2.6 ns
  3. C+0.6 ns
정답과 해설 보기

정답: C. +0.6 ns

멀티사이클 패스를 2로 하면 캡처 에지가 1주기 후가 아니라 2주기 후가 됩니다. 요구 시각은 2 × 2.0 − 0.1 = 3.9 ns, 도착 시각은 3.3 ns이므로 슬랙은 +0.6 ns입니다. −1.4 ns는 일반적인 1사이클 그대로 계산한 값, +2.6 ns는 3사이클분의 시간을 준 값입니다. 멀티사이클 패스는 인에이블 신호 등으로 실제로 2사이클마다만 캡처하는 회로임을 설계자가 확인한 후에 설정해야 합니다.

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  2. 폴스 패스(set_false_path)를 설정하는 것이 적절한 경로는?
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