MOSFET
下列何者是大致表示CMOS邏輯閘延遲時間的適當公式？（C：負載電容，V：電源電壓，I：驅動電流）
- AC × V ÷ I
- BI ÷ (C × V)
- CC × V × I
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正確答案：A. C × V ÷ I
邏輯閘的延遲可視為以電流I將負載電容C充放電至電源電壓V所需的時間，大致表示為 CV/I。隨著微縮，C變小而變快，但降低電壓V時I的減少幅度更大，因此延遲反而增加。這個公式是思考高速化方針的基礎，例如減少配線電容、增加電晶體的驅動電流、抑制扇出，也用於估算環形振盪器的頻率。