Logikschaltungen

Welche Beschreibung der Funktionsweise eines D-Latches ist richtig?

  1. AEs übernimmt den Eingang nur im Moment der steigenden Taktflanke
  2. BEs gibt den Eingang stets invertiert aus
  3. CSolange das Enable-Signal aktiv ist, wird der Eingang unverändert an den Ausgang weitergegeben, und bei Inaktivität wird der Wert gehalten
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Antwort: C. Solange das Enable-Signal aktiv ist, wird der Eingang unverändert an den Ausgang weitergegeben, und bei Inaktivität wird der Wert gehalten

Ein D-Latch ist ein pegelgesteuertes Speicherelement: Solange Enable aktiv ist, erscheint der Eingang unverändert am Ausgang (transparent), und der Wert im Moment der Deaktivierung wird gehalten. Es braucht weniger Bauelemente als ein Flipflop und wird mitunter beim Latch-basierten Timing-Entwurf (Time Borrowing) zur Beschleunigung genutzt, doch da Signale während der Transparenz durchlaufen, wird die Timing-Analyse schwieriger. Ein D-Flipflop, das nur im Moment der Flanke übernimmt, entsteht durch Zusammenschalten zweier gegenphasiger Latches.

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