Qu'est-ce que Inférence ?

Traitement d'IA qui produit une réponse à partir d'une entrée par la seule propagation avant, à l'aide des poids fixés par l'entraînement. Il demande moins de calcul et de mémoire que l'entraînement.

Nom japonais: 推論

« Inférence » apparaît dans 23 questions d'entraînement réparties sur 5 thèmes, dont Pile matérielle et logicielle de l'IA, CPU et architecture, Programmation GPU.

Domaine: Pile matérielle et logicielle de l'IA

S'entraîner : questions sur Inférence

Quelle est la principale raison pour laquelle les GPU conviennent aux calculs matriciels et à l'entraînement et l'inférence en IA ?

  1. ALeur fréquence d'horloge est plus de 100 fois celle d'un CPU
  2. BIls disposent de nombreuses unités de calcul simples et traitent de grandes quantités de données en parallèle
  3. CIls n'ont pas de mémoire
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Réponse : B. Ils disposent de nombreuses unités de calcul simples et traitent de grandes quantités de données en parallèle

Le GPU, conçu à l'origine pour traiter simultanément de nombreux pixels d'écran, aligne des milliers à plus de 10 000 unités de calcul simples. Pour les traitements qui répètent le même calcul sur de grandes quantités de données, comme le calcul matriciel, ce parallélisme offre des performances élevées. Les GPU récents intègrent des unités dédiées au calcul matriciel (Tensor Core, etc.) et de la HBM à large bande passante, et sont devenus les principaux acteurs de l'entraînement en IA. Les traitements séquentiels riches en branchements restent le point fort du CPU.

Quel circuit dédié, intégré notamment aux SoC de smartphones, réalise l'inférence d'IA rapidement et avec une faible consommation ?

  1. APLL (boucle à verrouillage de phase)
  2. BConvertisseur analogique-numérique
  3. CNPU (unité de traitement neuronal)
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Réponse : C. NPU (unité de traitement neuronal)

Le NPU est un circuit dédié qui traite massivement en parallèle, en basse précision comme les entiers de 8 bits ou moins, les multiplications-accumulations qui constituent l'essentiel du calcul des réseaux de neurones. Ses performances par watt dépassent d'au moins un ordre de grandeur celles d'un processeur généraliste, ce qui permet de traiter dans le smartphone la retouche photo, la reconnaissance vocale ou la traduction. Ses performances s'expriment en TOPS (billions d'opérations par seconde), et son intégration s'étend aux SoC pour PC.

« Inférence » dans les explications

Questions mentionnant « Inférence » (23)

  1. Quelle est la principale raison pour laquelle les GPU conviennent aux calculs matriciels et à l'entraînement et l'inférence en IA ?
  2. Quel circuit dédié, intégré notamment aux SoC de smartphones, réalise l'inférence d'IA rapidement et avec une faible consommation ?
  3. En inférence d'IA, quel est le principal avantage de la conversion (quantification) des poids de FP32 en INT8 ?
  4. Quelle différence entre « entraînement » et « inférence » d'un réseau de neurones est correcte ?
  5. Laquelle des propositions suivantes n'explique pas pourquoi la mémoire nécessaire à l'entraînement est bien plus grande que pour l'inférence du même modèle ?
  6. En inférence, pourquoi l'augmentation de la taille de lot (nombre d'entrées traitées ensemble) tend-elle à améliorer l'efficacité globale ?
  7. Quel est l'inconvénient d'une taille de lot trop grande en inférence ?
  8. L'inférence d'un grand modèle de langage se divise en une phase traitant l'ensemble du texte d'entrée (prefill) et une phase produisant la sortie jeton par jeton (décodage). Quelle combinaison des facteurs déterminant principalement leurs performances est correcte (pour un petit lot) ?
  9. Quel est le rôle du cache KV utilisé dans l'inférence des grands modèles de langage ?
  10. Dans l'inférence d'un grand modèle de langage, quel problème survient souvent avec des textes longs ou de grands lots ?
  11. Quelle est la principale raison pour laquelle les environnements d'exécution d'inférence comme TensorRT ou ONNX Runtime sont plus rapides qu'une inférence directe dans le framework d'entraînement ?
  12. Dans l'inférence des grands modèles de langage, pourquoi la quantification des seuls poids sur 4 bits, les activations restant en FP16 (W4A16), accélère-t-elle particulièrement le décodage ?
  13. Laquelle des propositions suivantes n'est pas un avantage de l'inférence d'IA effectuée dans le terminal (edge), comme un smartphone, plutôt que sur un serveur dans le cloud ?
  14. Quelle est la principale raison pour laquelle le NPU d'un SoC de smartphone est plus efficace énergétiquement que le CPU pour l'inférence d'IA ?
  15. Pour un grand modèle de langage de N paramètres, quel est l'ordre de grandeur du nombre d'opérations nécessaires à l'inférence d'un jeton (hors attention) ?

Termes associés

GPU NPU (unité de traitement neuronal) Cache KV Rétropropagation SoC (système sur puce) INT8 Taille de lot (batch size) Intensité arithmétique Préremplissage (prefill) Attention

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